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1、《數(shù)字電路與數(shù)字邏輯》練習(xí)題一 、填空 1將下列二進(jìn)制數(shù)轉(zhuǎn)為十進(jìn)制數(shù) (1001011) B = ( )D ( 11 . 011 ) B = ( )D 2?將下列有符號(hào)的十進(jìn)制數(shù)轉(zhuǎn)換成相應(yīng)的二進(jìn)制數(shù)真值、原碼、反碼和補(bǔ) 碼 (+122)=( =( )真值=( )反碼=( )原碼 )補(bǔ)碼 3.把下列4個(gè)不同數(shù)制的數(shù)(376.125) d、(110000) B、(17A) H、(67) 0(按 從大到小的次 )>( )>( )。將下列各式變換 成最簡(jiǎn)與或式的形式

2、 AB AC BC =( 4. 將下列二進(jìn)制數(shù)轉(zhuǎn)為十進(jìn)制數(shù) (101000) b =( D 5. 將下列十進(jìn)制數(shù)轉(zhuǎn)為二進(jìn)制數(shù)， (0. 8125)=( H (254 . 25)=( h 6. 將下列有符號(hào)的十進(jìn)制數(shù)轉(zhuǎn)換成相應(yīng)的二進(jìn)制數(shù)真值、 ( ( ( ( (+125) (—42 ) =( =( =( =( (11 . 0101 ) B 八進(jìn)制數(shù)和十六進(jìn)制數(shù) B =( ) ) ) ) 真值 反碼 真值 反碼 原碼、反碼和補(bǔ)碼 ) ) ) ) 原碼 補(bǔ)碼 原碼 補(bǔ)碼 7.邏輯函數(shù)F =AB +CD +AC的對(duì)偶函數(shù)F"是 ;

3、其反函數(shù)F是 。 8 .當(dāng)Yj時(shí)，同一邏輯函數(shù)的最小項(xiàng)m「mj = ；兩個(gè)最大項(xiàng) M j + M j = 。 9. （43.5） 10= （ ） 2= （ ） 16。 10. n個(gè)輸入端的二進(jìn)制譯碼器，共有 輸出端，對(duì)于每一組輸入代 碼，將有 輸出端具有有效電平。 11. 將下列二進(jìn)制數(shù)轉(zhuǎn)為十進(jìn)制數(shù) （1010001）B = （ ）D （11. 101）B = （ ）D 12. 將下列有符號(hào)的十進(jìn)制數(shù)轉(zhuǎn)換成相應(yīng)的二進(jìn)制數(shù)真值、原碼、反碼和補(bǔ)碼 (+254.25 )=( ）真值 =( ）原碼 =( 反碼=（ : ）補(bǔ)碼 13.把下列4個(gè)不同數(shù)制的數(shù)

4、(76.125)D、(27A)H、(10110)B、 (67)0 按從大到小的次序排 列（ ）＞ （ )>( )>( ) 。 14. 對(duì)于D觸發(fā)器，欲使 Qn+仁Qn輸入D=（ ）,對(duì)于T觸發(fā)器，欲使 Qn+仁Qn輸入T= （ ） 15. 一個(gè)512*8位的ROM芯片，地址線為（ ）條，數(shù)據(jù)線為（ ）條。 16. 對(duì)32個(gè)地址進(jìn)行譯碼，需要（ ）片74138譯碼器。 17. 存儲(chǔ)器起始地址為全 0, 256K*32的存儲(chǔ)系統(tǒng)的最高地址為（ ）。 18. 將下列各式變換成最簡(jiǎn)與或式的形式 （ ） （ ） （ ） 19?五級(jí)觸發(fā)器的進(jìn)位模數(shù)最大為（ ）進(jìn)制。

5、 20. 十進(jìn)制數(shù)（78.25 ） 10轉(zhuǎn)換成十六進(jìn)制數(shù)是 （ ），轉(zhuǎn)換成二進(jìn)制數(shù)是（ ）， 轉(zhuǎn)換成八進(jìn)制數(shù)是（ ），轉(zhuǎn)換成8421BCD碼為（ ）。 21. 將二進(jìn)制1100110轉(zhuǎn)換成余3碼為（ ），轉(zhuǎn)換成格雷碼為（ ）。 22. 設(shè)真值X= — 0101，則X的原碼為（ ），反碼為（ ），補(bǔ)碼為（ ）。 23. 卡諾圖是（ ）的一種特殊形式。利用卡諾圖法花劍邏輯函數(shù)比（ ）法更容易 得到簡(jiǎn)化的邏輯函數(shù)表達(dá)式。 24. 函數(shù)L=AC+BC勺對(duì)偶式為：（ ）。 25. 一個(gè)1024*16位的ROM芯片，地址線為（ ）位，數(shù)據(jù)線為（ ）位。 26. 對(duì)于JK觸發(fā)器，若J=K，

6、可完成（ ）觸發(fā)器的邏輯功能。 27. 組合邏輯電路中部包含存儲(chǔ)信號(hào)的（ ）元件，它一般是由各種（ ）組合而成 的。 28. 對(duì)64個(gè)地址進(jìn)行譯碼，需要（ ）片74138譯碼器。 29. AB+AC化成最小項(xiàng)的形式為（ ）。 30. 將變換成或非的形式為（ ）。 31. 數(shù)制轉(zhuǎn)換 （6.3125）10=（ ）2 （1101.1101）2=（ ）10 32. 將下列有符號(hào)的十進(jìn)制數(shù)轉(zhuǎn)換成相應(yīng)的二進(jìn)制數(shù)真值、原碼、反碼和補(bǔ)碼 （+11/32）=（ ） 真值=（ ） 原碼 =（ ） 反碼=（ ） 補(bǔ)碼 (-15/64)=( ) 真值=( ) 原碼 =( ) 反碼=( )

7、補(bǔ)碼 33. 把下列3個(gè)數(shù)(76.125)D、(27A)H、(67)0按從大到小的次序排列 ( )>( )>( ) 34. 已知二進(jìn)制數(shù)1100101，將其轉(zhuǎn)換成格雷碼為( ) 。 35. 已知格雷碼編碼為 1100101，將其轉(zhuǎn)換成二進(jìn)制數(shù)為( ) 。26?將下 列二進(jìn)制數(shù)轉(zhuǎn)為十進(jìn)制數(shù) (101001) B = ( ) D (110. 1001) B = ( ) D 36. 將下列十進(jìn)制數(shù)轉(zhuǎn)為二進(jìn)制數(shù)，八進(jìn)制數(shù)和十六進(jìn)制數(shù) (51) = ( ) B = ( ) O = ( ) H (5. 3125) = ( ) B = ( ) O = ( ) H 37. 將下列有符號(hào)的十

8、進(jìn)制數(shù)轉(zhuǎn)換成相應(yīng)的二進(jìn)制數(shù)真值、原碼、反碼和補(bǔ)碼 (+104): =( )真值= ( )原碼 =( )反碼= ( )補(bǔ)碼 (—39): =( )真值= ( )原碼 =( )反碼 =( )補(bǔ)碼 38.將下列各式變換成最簡(jiǎn)與或式的形式 A +B = A + A B = A + A B = (A + B ) (A + C )= 二、選擇題 )。 -5v 1. 和二進(jìn)制數(shù)(1100110111.001)等值的十六進(jìn)制數(shù)學(xué)是 ( (A) 337.2 (B)637.2 (C)1467.1 (D)c37.4 2. 是8421BCD碼的是(

9、 ) (A)1010 (B)0101 (C)1100 (D)1111 3 .和二進(jìn)制碼1100對(duì)應(yīng)的格雷碼是( ) (A)0011 (B)1100 (C)1010 (D)0101 4. 如右圖，電路實(shí)現(xiàn)的邏輯功能 F=() (A)AB (B)0 (C)A+B (D)1 5. TTL電路中，高電平 Vh的標(biāo)稱值是( ) (A)0.3V (B)2.4V (C)3.6V (D)5V 6. 和邏輯式 A ABC相等的式子是() (A)ABC (B)1+BC (C)A (D) A BC 7. 若干個(gè)具有三態(tài)輸出的電路輸出端接到一點(diǎn)工作時(shí)，必須保證( ) (A) 任何時(shí)候最

10、多只能有一個(gè)電路處于三態(tài)，其余應(yīng)處于工作態(tài)。 (B) 任何時(shí)候最多只能有一個(gè)電路處于工作態(tài)，其余應(yīng)處于三態(tài)。 (C) 任何時(shí)候至少要有兩個(gè)或三個(gè)以上電路處于工作態(tài)。 (D) 以上說(shuō)法都不正確。 8. A+B+C+ A+A B=( ) (A)A (B) A (C) 1 (D)A+B+C 9. 下列等式不成立的是( ) (A) A AB = A B (B)(A+B)(A+C)=A+BC (C) AB+AC+BC=AB+BC (D) AB AB AB AB =1 10. F(A,B, C) = m(0,1,2,3,4,5,6),則 F=() (A)ABC (B

11、)A+B+C (C) A B C (D) ABC 三、簡(jiǎn)答 1. 一呆簡(jiǎn)與或式；-I ■■ -—( 8 分) 2、 ( 1)化簡(jiǎn)下面的式子(6分) L(A, B,C,D) = m(0,1,2,5,6,7,8,9,13,14) 、d(10,11) (2)分析此組合邏輯電路的邏輯功能( 7分) 3、分析以下電路，說(shuō)明電路功能。 (10 分) Ci + L CP 90 . Q1 四、化簡(jiǎn)題 1?將邏輯函數(shù)F = BCD - AB - ABCD - BC轉(zhuǎn)化為最小項(xiàng)表達(dá)式 2?卡諾圖法化簡(jiǎn)邏輯函數(shù) F(A, B,C,D) = ABCD ABC

12、D ACD AD。 3. 將圖示波形作用在維持阻塞JK觸發(fā)器上，試畫(huà)出觸發(fā)器Q端的工作波形（設(shè) 五、組合邏輯設(shè)計(jì)題 1. 3-8譯碼器的各輸入端的連接情況及第六腳輸入信號(hào) A的波形如下圖所示 試畫(huà)出輸出丫0，Y"Y3，Y4，丫5引腳的波形。（10分）。 1 凡 L6 * 總 * ■ 9 2 3 4 15 -b 7 8 廠 2?在舉重比賽中，有甲、乙、丙三位裁判，其中甲為主裁判，當(dāng)兩位或兩位以 上裁判（其中必須包括甲裁判在內(nèi)）認(rèn)為運(yùn)動(dòng)員上舉合格，才可發(fā)出合格信 號(hào)，試用3-8譯碼器和邏輯門(mén)設(shè)計(jì)上述要求的組合邏輯電路

13、。 （10分） 74138 A2 Ao 1 "1 1 1 3?設(shè)計(jì)一個(gè)組合邏輯電路，其功能是將 8-4-2-1 BCD碼轉(zhuǎn)換成余3碼，門(mén)電路不限。畫(huà)出 真值表并寫(xiě)出相應(yīng)的邏輯表達(dá)式即可。 （注：余 3 碼=BCD 碼 + 0011） （12 分） 4.設(shè)計(jì)一個(gè)四位格雷碼變二進(jìn)制數(shù)的轉(zhuǎn)換電路，推出相應(yīng)的邏輯表達(dá)式即可（ 12 分） 5.（6分）用74LS151（8選一數(shù)據(jù)選擇器）實(shí)現(xiàn)三人表決電路（即三人表決一 件事，按照少數(shù)服從多數(shù)的原則）。 6.設(shè)計(jì)一個(gè)組合電路，用來(lái)判斷輸入的四位 8421BCD碼A , B, C, D當(dāng)其值 大于或等于5時(shí)，輸出為1

14、,反之輸出為0。寫(xiě)出邏輯表達(dá)式即可 4.設(shè)計(jì)一個(gè)四位格雷碼變二進(jìn)制數(shù)的轉(zhuǎn)換電路，推出相應(yīng)的邏輯表達(dá)式即可（ 12 分） 4.設(shè)計(jì)一個(gè)四位格雷碼變二進(jìn)制數(shù)的轉(zhuǎn)換電路，推出相應(yīng)的邏輯表達(dá)式即可（ 12 分） 六、組合電路分析題 L1 L2 L3 2、分析下圖組合邏輯電路功能。（10分） A B C. D觸發(fā)器。） 3 ?已知電路如圖所示。（其中，觸發(fā)器為上升沿觸發(fā)的邊沿型 （1 ）寫(xiě)出狀態(tài)方程； （2 ）畫(huà)出電路的狀

15、態(tài)轉(zhuǎn)換圖 （18 分） （3 ）根據(jù)狀態(tài)轉(zhuǎn)換圖，說(shuō)出電路的邏輯功能，檢查電路能否自啟動(dòng)。 4 .試分析如下電路，寫(xiě)出 F的表達(dá)式。（10分） 5 ?分析下圖，寫(xiě)出 F的表達(dá)式。（15分） ABAC BC AB ABC （15 分） 6?下圖中設(shè)初態(tài)QdQcQbQa = 0000，試分析該電路 r L P 9A QF QC CD r TTL74161 Jc ■ CF_ CrU） A E D D 1 1 1 II rr 《數(shù)

16、字電路與數(shù)字邏輯》練習(xí)題 一、填空題 1. 2. 3. 4. 5. (11.001) 2=( (-1101) 2=( (75)10=( 觸發(fā)器有 個(gè)觸發(fā)器。— )16= ( ) 10 ）原碼=（ ）8421BCD（ 個(gè)穩(wěn)態(tài)， 米利型時(shí)序電路輸出信號(hào)與 和 ）補(bǔ)碼 ）余3碼 存儲(chǔ)8位二進(jìn)制信息要 有關(guān),沒(méi)有輸入變量 的時(shí)序電路又稱—型電路。 如果某計(jì)數(shù)器中的觸發(fā)器不是同時(shí)翻轉(zhuǎn)，這種計(jì)數(shù)器稱為 計(jì)數(shù)器，n 進(jìn)制計(jì)數(shù)器中的n表示計(jì)數(shù)器的 ，最大計(jì)數(shù)值是 。 A/D轉(zhuǎn)換的基本步驟是 、 、 、 四

17、 個(gè)步驟。 6.半導(dǎo)體存儲(chǔ)器從存，取功能上可以分為 和 、單項(xiàng)選擇題 1 .在下列（ ）輸入情況下，與非運(yùn)算的結(jié)果等于邏輯 0 ① 全部輸入0 ②僅有一端輸入0 ③全部輸入1 ④ 僅有一端輸入1 2.下列器件中，屬于組合邏輯電路的是（ ①計(jì)數(shù)器和全加器 ②寄存器和比較器 ③計(jì)數(shù)器和寄存器 ④全加器和比較器 3 .—個(gè)8421BCD碼計(jì)數(shù)器，至少需要（ ）個(gè)觸發(fā)器。 ①3 ②4 ③5 ④10 4. 一個(gè)16選一數(shù)據(jù)選擇器，其地址輸入端有（ ）個(gè)。 ④8 。 ②有0出1,全1出0 ④有0出0,有1

18、出1 其轉(zhuǎn)換電路中的虛線框處應(yīng)是（ ①1 ②2 ③4 5. 不符合常用邏輯關(guān)系的說(shuō)法是（ ①有0出0,全1出1 ③有1出1,全0出0 6. 將JK觸發(fā)器轉(zhuǎn)換成D觸發(fā)器, ① 與非門(mén) ② 異或門(mén) ③ 連接線 ④ 非門(mén) CP 、判斷題 1?一個(gè)邏輯函數(shù)的對(duì)偶式只是將邏輯函數(shù)中的原變量換成反變量，反變量換成原變量。 2 ?卡諾圖方格中1所對(duì)應(yīng)的最小項(xiàng)之和組成原函數(shù)。 3. 維持阻塞D觸發(fā)器克服了空翻。 4 ?雙向移位寄存器電路中沒(méi)有組合邏輯電路。 5 ?集電極開(kāi)路門(mén)有高電平、低電平、高阻等狀態(tài)。 6 ?鎖存器是克服了空翻的寄存器。 7 ?或非門(mén)組成的 RS觸發(fā)

19、器的約束條件是 RS=0。 &觸發(fā)器的輸出是現(xiàn)態(tài)函數(shù)。 9 ?編碼器可以構(gòu)成函數(shù)發(fā)生器。 10、 邏輯函數(shù)化簡(jiǎn)后的結(jié)果是唯一的。 11、 四、計(jì)算題 ?集成電路定時(shí)器555構(gòu)成的定時(shí)電路和輸入波形 Vi如圖所示，已知輸入波形 V1的 周期為T(mén)1=500ms。（ 1）請(qǐng)說(shuō)明該電路組成什么功能的脈沖電路？ （ 2）試畫(huà)出所對(duì)應(yīng) 的輸出電壓Vo的工作波形。（3）求出暫穩(wěn)寬度tw和輸出波形的周期。（8分） 簡(jiǎn)答題 （8 分） 某存儲(chǔ)器有6條地址線和4條數(shù)據(jù)線，則該存儲(chǔ)器的容量是

20、多少? 2 .試用2片64X8位的RAM組成128X8位的存儲(chǔ)器。（8分） I || | 1 1 1 I IJ A.A g I 1 t i袋a 0 I/O4 I/O5 IJQ； I RAM )4x8^ 3 A4 a5 R/W cs 1 1 1 Y I Jj U03 I Ig w RAM 64灼位 % Aj A3 A3 A4 Aj r/w CS itii rr i y 3. 用74LS138(3-8譯碼器)和與非門(mén)組合實(shí)現(xiàn)邏輯函數(shù) F

21、 (A,B,C) = m(1,2,4,7) 的組合邏輯電路，并說(shuō)明功能。 4. 組合邏輯電路如圖，試寫(xiě)出 F的最簡(jiǎn)表達(dá)式，并說(shuō)明功能 A B F 六、畫(huà)圖題 1. 用兩個(gè)74LS138設(shè)計(jì)一個(gè)4-16的譯碼器。(10分) A2 Al AO G1 G2A G2B E fl —  2. 下降沿觸發(fā)的主從 RS觸發(fā)器輸入信號(hào)波形如下圖所示，請(qǐng)畫(huà)出輸出端Q的對(duì)應(yīng)波形。（設(shè) 觸發(fā)器初態(tài)為0） 口_rLrLTLrLTLrL s _r^_nrn 3. 上升沿觸發(fā)的維持-阻塞D觸發(fā)器輸入信號(hào)波形如下圖所示，請(qǐng)畫(huà)出輸出端 Q的對(duì)應(yīng)波

22、形。（設(shè)觸發(fā)器初態(tài)為 0） ep_TLTLn_n_ D _IL T CP—— IN - Cj > 4. 如題下圖所示的電路和波形，試畫(huà)出 Q端的波形。設(shè)觸發(fā)器的初始狀態(tài)為 Q=0b rLTLn^ 5、 F (A, B, C, D) =Em(0, 2, 5, 7, 8, 10, 13, 15) 6. 用74LS138設(shè)計(jì)一個(gè)電路實(shí)現(xiàn)函數(shù) F = AB+ B C (10分) 七、分析題 1、分析如下的時(shí)序邏輯電路圖，畫(huà)出其狀態(tài)表和狀態(tài)轉(zhuǎn)換圖，并做出輸入信號(hào) 為011011111的輸出波形，觸發(fā)器的初態(tài)為 00。（ 14分） 2.分析下面

23、的電路圖，畫(huà)出其狀態(tài)表和狀態(tài)圖，并說(shuō)明電路的功能 CP 3.分析下面的電路圖，說(shuō)明其功能 z CP 4.分析下面的電路圖，畫(huà)出其狀態(tài)表。 八、設(shè)計(jì)題 (10 1、試用正邊沿JK觸發(fā)器設(shè)計(jì)一個(gè)同步時(shí)序電路，其狀態(tài)轉(zhuǎn)換圖如圖所示 分） Fa 1 ?用D觸發(fā)器設(shè)計(jì)一個(gè)“ 0011”序列檢測(cè)器， 要求用一個(gè)輸出信號(hào)來(lái)表

24、示檢測(cè)結(jié)果。 （20 分） 2 .試設(shè)計(jì)一個(gè) 8421BCD碼的檢碼電路。要求當(dāng)輸入量 DCB髯2或》7時(shí)，電路輸出F為高 電平，否則為低電平。用與非門(mén)設(shè)計(jì)該電路，寫(xiě)出 F表達(dá)式。（6分） 4?分析下圖所示的各邏輯電路，分別寫(xiě)出圖（ a) ,(b)中F1 (A, B, C, D)的最簡(jiǎn)與或表 達(dá)式，F(xiàn)2 （A, B, C, D）的最小項(xiàng)表達(dá)式以及 F3 （A, B, C, D）的最大項(xiàng)表達(dá)式。（6分） 5. （6分）按步驟分析圖示時(shí)序邏輯電路，畫(huà)出在 CP作用下的狀態(tài)轉(zhuǎn)換圖，并 判定有無(wú)自啟動(dòng)特點(diǎn)。（設(shè)初態(tài)Q2Q1Q0 =000 ） 6

25、． A、B、C、D、E、F 六名學(xué)生中選拔若干名去留學(xué)，人選的配備要求如下： ① A 、 B 二人中至少去 1 人； ② A 、 D 不能一起去； ③ A 、 E、 F 三人中要派兩人去； ④ B 、 C 兩人中都去或都不去； ⑤ C 、 D 兩人只能去 1 人； ⑥ 若D不去，則E也不去。請(qǐng)問(wèn)：應(yīng)選哪幾名學(xué)生 ？（ 10分） 7. 用JK觸發(fā)器設(shè)計(jì)一個(gè)“ 111 ”序列檢測(cè)器，允許重復(fù)，要求用一個(gè)輸出信號(hào)來(lái)表示檢測(cè)結(jié) 果。（ 16 分） 8. 試用 74161 設(shè)計(jì)一個(gè)同步十進(jìn)制計(jì)數(shù)器，要求采用兩種不同的方法。 （10分） 9. 試設(shè)計(jì)一個(gè)4輸入、4輸出邏輯電路。當(dāng)控制信號(hào)

26、 C=0時(shí)，輸出狀態(tài)與輸人狀態(tài)相反；當(dāng) C=1 時(shí)輸出狀態(tài)與輸入狀態(tài)相同。 （10 分） 10. 用D觸發(fā)器設(shè)計(jì)一個(gè)模 6計(jì)數(shù)器寫(xiě)出表達(dá)式即可。（10分） 11 ?用D觸發(fā)器設(shè)計(jì)一個(gè)“ 1001 ”序列檢測(cè)器， 要求用一個(gè)輸出信號(hào)來(lái)表示檢測(cè)結(jié)果寫(xiě)出 表達(dá)式即可。 （ 20 分） 12. 試用正邊沿D觸發(fā)器設(shè)計(jì)一個(gè)1100序列檢測(cè)器，它有一個(gè)輸入端和一個(gè)輸出端， 寫(xiě)出輸 出方程和驅(qū)動(dòng)方程即可。 13. 設(shè)計(jì)一個(gè)帶控制端的組合邏輯電路，控制端 X=0時(shí)，實(shí)現(xiàn)F=A+B控制端X=1時(shí)，實(shí)現(xiàn)， 請(qǐng)用 74LS138 和必要的門(mén)電路實(shí)現(xiàn)。 （10 分） 14. 畫(huà)出符合以下關(guān)系的 010序列檢測(cè)器的狀態(tài)轉(zhuǎn)換圖， X為序列輸入，Z為檢測(cè)輸出。（10 分） X： 1010101010 Z： 0001000100 15. 設(shè)計(jì)一個(gè)同步四進(jìn)制加法計(jì)數(shù)器 ，用D觸發(fā)器。（15分） 16. 設(shè)計(jì)一個(gè)余 3 碼轉(zhuǎn)換成 8421 碼的轉(zhuǎn)換電路寫(xiě)出表達(dá)式即可。 17. 用D觸發(fā)器設(shè)計(jì)一個(gè)“ 1000”序列檢測(cè)器， 要求用一個(gè)輸出信號(hào)來(lái)表示檢測(cè)結(jié)果。 （20 分）