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中國石油大學(xué)（北京）遠程教育學(xué)院 《數(shù)字邏輯》期末復(fù)習(xí)題 一、單項選擇題 1. TTL 門電路輸入端懸空時，應(yīng)視為( A ) A. 高電平 B. 低電平 C. 不定 D. 高阻 2. 最小項的邏輯相鄰項是（ D ） A．ABCD B． C． D． 3. 全加器中向高位的進位為( D ) A. B. C. D. 4. 一片十六選一數(shù)據(jù)選擇器，它應(yīng)有（ A ）位地址輸入變量 A. 4 B. 5 C. 10 D. 16 5. 欲對78個信息以二進制代碼表示，則最少需要（ B ）位二進制碼 A. 4 B. 7 C. 78 D. 10 6. 十進制數(shù)25用8421BCD碼表示為（B ） A.10 101 B.0010 0101 C.100101 D.10101 7. 常用的BCD碼有（C ） A:奇偶校驗碼 B:格雷碼 C:8421碼 D:ASCII碼 8. 已知,下列結(jié)果中正確的是（C） A:Y=A B:Y=B C:Y=A+B D: 9. 下列說法不正確的是（ D） A:同一個邏輯函數(shù)的不同描述方法之間可相互轉(zhuǎn)換 B:任何一個邏輯函數(shù)都可以化成最小項之和的標準形式 C:具有邏輯相鄰性的兩個最小項都可以合并為一項 D:任一邏輯函數(shù)的最簡與或式形式是唯一的 10. 邏輯函數(shù)的真值表如下表所示，其最簡與或式是（C ） A: B: C: D: 11．以下不是邏輯代數(shù)重要規(guī)則的是( D ) 。 A. 代入規(guī)則 B. 反演規(guī)則 C. 對偶規(guī)則 D. 加法規(guī)則 12．已知函數(shù)的反函數(shù)應(yīng)該是( A ) 。 A. B. C. D. 13．組合邏輯電路一般由（ A ）組合而成。 A、門電路 B、觸發(fā)器 C、計數(shù)器 D、寄存器 14．求一個邏輯函數(shù)F的對偶式，可將F中的（ A ）。 A、“”換成“+”，“+”換成“”,常數(shù)中的“0”“1”互換 B、原變量換成反變量，反變量換成原變量 C、變量不變 D、常數(shù)中的“0”換成“1”，“1”換成“0” 15．邏輯函數(shù) ( A ) 。 A. AB+AC+AD+AE B. A+BCED C. (A+BC)(A+DE) D. A+B+C+D+E 16．下列邏輯電路中，不是組合邏輯電路的有（ D ） A、譯碼器 B、編碼器 C、全加器 D、寄存器 17．邏輯表達式A+BC=（ C ） A、AB B、A+C C、(A+B)(A+C) D、B+C 18．在（ A ）輸入情況下，“或非”運算的結(jié)果是邏輯“1”。 A.全部輸入為“0” B.全部輸入為“1” C.任一輸入為“0”，其他輸入為“1” D.任一輸入為“1” 19．邏輯函數(shù)同之間關(guān)系為( A ) A. B. C. D.無關(guān) 20．時序邏輯電路一定包含（ A ） A、觸發(fā)器 B、組合邏輯電路 C、移位寄存器 D、譯碼器 21．時序邏輯電路中必須有（ A ） A、輸入邏輯變量 B、時鐘信號 C、計數(shù)器 D、編碼器 22．邏輯函數(shù)( A ) 。 A. B. C. D. A(B+C) 23．已知函數(shù)，根據(jù)反演規(guī)則得到的反函數(shù)是（ A ） A． B．（A+B）（C+D） C． D． 24．最小項的邏輯相鄰項是（ D ） A．ABCD B． C． D． 25．Mealy型時序邏輯電路的輸出( C )。 A.只與當(dāng)前外部輸入有關(guān) B. 只與電路內(nèi)部狀態(tài)有關(guān) C.與外部輸入和內(nèi)部狀態(tài)都有關(guān) D. 與外部輸入和內(nèi)部狀態(tài)都無關(guān) 26．邏輯函數(shù) ( A ) 。 A. B. C. D. A(B+C) 27．JK觸發(fā)器在CP脈沖作用下，欲實現(xiàn)，則輸入信號不能為（ D ） A．J=K=0 B．J=Q，K= C．J=,K=Q D．J=Q,K=0 28．邏輯函數(shù)=（ A ） A．∑m(0,1,3,6,7) B．∏m(0,1,3,6,7) C．∑m(6,7) D．AB+C 29．下列觸發(fā)器中沒有約束條件的是（ D ） A、基本RS觸發(fā)器 B、主從RS觸發(fā)器 C、維持阻塞RS觸發(fā)器 D、邊沿D觸發(fā)器 30．欲得到D觸發(fā)器的功能，以下諸圖中唯有圖（ A ）是正確的 A. B. C. D. 31. 以下四個系列的 TTL 集成電路，其中功耗最小的為（ D ） A. CT74 B. CT74H C. CT74S D. CT74LS 32. 下列門電路，不屬于基本邏輯門的是（ A ） A. 異或門 B. 與門 C. 或門 D. 非門 33．n個變量函數(shù)的最小項是 ( C ) 。 A. n個變量的積項，它包含全部n個變量 B. n個變量的和項，它包含n個變量 C.每個變量都以原、反變量的形式出現(xiàn)，且僅出現(xiàn)一次 D. n個變量的和項，它不包含全部變量 34. 下圖示觸發(fā)器電路的特征方程Qn+1 =（ A ） A. B. C. D. T 35. 圖示ROM陣列邏輯圖，當(dāng)?shù)刂窞锳1A0=10時，該字單元的內(nèi)容為（ C ） A. 1l10 B. 111 C. 1010 D. 100 36. 譯碼器的邏輯功能是將（D ） A:輸入的二進制代碼譯成對應(yīng)輸出的二進制代碼 B:輸入的高、低電平譯成對應(yīng)輸出的二進制代碼 C:輸入的高、低電平譯成對應(yīng)輸出的高、低電平 D:輸入的二進制代碼譯成對應(yīng)輸出的高、低電平 37. （ A ） A. A B. B C. 1 D.0 38. 由與非門構(gòu)成的基本RS觸發(fā)器兩個輸入端時，觸發(fā)器的狀態(tài)為（ C ） A. B.Q=1，1 C. Q=0，1 D. Q=0，0 27. 下圖所示邏輯圖輸出為“1”時，輸入變量ABCD取值組合為（ C ） A. 0 B. 101 C. 1110 D. 1111 32. 集電極開路門（OC 門）在使用時須在（ C ）之間接一電阻. A. 輸出與地 B. 輸出與輸入 C. 輸出與電源 D. 輸入與電源 二、填空題 1．組合電路中的險象可根據(jù)競爭冒險的原因不同分為 靜態(tài)險象 和 動態(tài)險象 。 2．?dāng)?shù)字邏輯電路一般分為 組合邏輯電路 和 時序邏輯電路 。 3．組合邏輯電路的特點是在任何時刻電路產(chǎn)生的穩(wěn)定輸出信號僅與該時刻電路的___輸入信號 有關(guān)。 4．組合邏輯電路的分析和設(shè)計所用到的主要工具是 真值表 ，而時序邏輯電路的分析和設(shè)計所要用到的工具主要是 狀態(tài)表和狀態(tài)圖 。 5．如果決定某一事件發(fā)生的多個條件中，只要有一個或一個以上條件成立，事件便可發(fā)生，則這種因果關(guān)系稱之為 或邏輯 。 6．將邏輯函數(shù)表達式F中所有的“”變成“+”，“+”變成“”，“0”變成“1”，“1”變成“0”，原變量變成反變量，反變量變成原變量，則所得到的新的函數(shù)為原函數(shù)F的反函數(shù)，這一規(guī)則稱為 反演規(guī)則 。 7．時序電路一般由 組合邏輯、存儲 器件和反饋回路三部分組成。 8．同步時序電路常用的方法有 表格法和代數(shù)法。 9．判斷一個電路是否可能產(chǎn)生險象的方法有代數(shù)法和卡諾圖法。 2．兩個帶符號的二進制的真值N1=-01010，N2=+10011，則 [N1]原= 101010 ， [N1]補= 110110， [N1]反=-110101 ，[N2]補= 010011 。 3．十進制正數(shù)N=5493，它的對10的補數(shù)為[N10]補= 05493 。 4．邏輯代數(shù)是一種二值代數(shù)系統(tǒng)，即任何邏輯變量的取值只有兩種可能性，取值 0 或取值 1 。 5．描述邏輯函數(shù)的方法常用的方法有： 邏輯表達式 、 真值表 和 卡諾圖 三種。 6．常用的觸發(fā)器有 D觸發(fā)器 、 JK觸發(fā)器 、 RS觸發(fā)器 和 T觸發(fā)器 。 7．計數(shù)器按工作方式可分 同步計數(shù)器 和 異步計數(shù)器 ;按其進位制可分為二進制計數(shù)器 、 十進制計數(shù)器 和 任意進制計數(shù)器 ;按其功能可分為： 加法計數(shù)器， 減法計數(shù)器和 加/減可逆計數(shù)器 等。 8．已知a=110，b=101,則a與b相或的結(jié)果為 111 。 三、判斷題 1．判斷兩個邏輯函數(shù)是否相等，通常有兩種方法，一種是列出輸入變量所有可能的取值的組合；另一種是邏輯代數(shù)的公理，定理和規(guī)則證明（ 對 ） 2．描述邏輯函數(shù)常用方法有邏輯表達式、真值表、卡諾圖（ 錯 ） 3．如果一個具有n個變量的函數(shù)和項包含全部n個變量，每個變量都以原變量或反變量形式出現(xiàn)，且僅出現(xiàn)一次，則這個和項稱為 最小項（ 錯 ） 4．2421碼的1011，其權(quán)展開式為3（ 錯 ） 5. 加法器是克服了空翻的寄存器 ( 錯 ) 6. 單向移位寄存器電路中沒有組合邏輯電路 ( 對 ) 7. 觸發(fā)器的輸出是現(xiàn)態(tài)函數(shù). ( 對 ) 8. 邏輯函數(shù)化簡后的結(jié)果是唯一的. ( 錯 ) 3．如果一個具有n個變量的函數(shù)和項包含全部n個變量，每個變量都以原變量或反變量形式出現(xiàn)，且僅出現(xiàn)一次，則這個和項稱為 最大項（ 對 ） 4．已知F=（A+B）（A+C1），則F’=AB+A（C+0）（ 錯 ） 5．(30.7)8421碼=（9.5）10 （ 對 ） 7. 鎖存器是克服了空翻的寄存器 ( 對 ) 8. 雙向移位寄存器電路中沒有組合邏輯電路 ( 錯 ) 11. 一個集成的二—十進制優(yōu)先編碼器有1個基本的輸出端. ( 錯 ) 四、 分析題 1. 分析如圖1給定的組合邏輯電路，寫出輸出P1，P2，P3，P4的邏輯表達式，并寫出輸出F的邏輯表達式。 B A C P1 C P4 P2 P3 & & & ≥1 & A B 根據(jù)圖可知，P1，P2，P3，P4的邏輯函數(shù)表達式如下 所以輸出F的邏輯表達式為： 2．輸入變量中無反變量時，用與非門實現(xiàn)下列邏輯函數(shù) F（A，B，C，D）=∑m（2，3，5，6） F（A，B，C，D）=∑m（2，3，5，6） 通過卡諾圖化簡，得到給定函數(shù)的最簡“與或”表達式： 合并上式中頭部相同的“與”項，得到表達式： 選擇替代尾部因子，得到表達式： 用與非門實現(xiàn)該函數(shù)表達式的邏輯電路圖如下： 3．設(shè)計一個序列檢測器，用來檢測串行二進制序列，要求每當(dāng)連續(xù)輸入3個（或3個以上）1時，檢測器輸出為1，否則輸出為0，典典型輸入序列如下： 輸入X：0 1 1 1 0 1 1 1 1 0 輸出Z：0 0 0 1 0 0 0 1 1 0 作出原始狀態(tài)圖。 解：設(shè)電路的初始狀態(tài)為A，檢測器接收到第一個后，用狀態(tài)B標記，連續(xù)接收兩個用C表示，連續(xù)接收3個或以上用D表示。 4．已知描述某組合電路的邏輯函數(shù)表達式為，試判斷該邏輯電路是否可能產(chǎn)生險象。 解：由函數(shù)表達式可知，變量A和C均具備競爭條件，所以應(yīng)對這兩個變量分別進行分析。先考察變量A，為此將B和C的各種取值組合分別代入函數(shù)表達式中，可得到如下結(jié)果： BC=00， BC=01， BC=10， BC=11， 由此可見，當(dāng)B=C=1時，A的變化可能使電路產(chǎn)生險象。 5. 用T觸發(fā)器實現(xiàn)J-K觸發(fā)器的功能，并畫出邏輯電路圖。 已知T觸發(fā)器的次態(tài)方程為： J-K觸發(fā)器的次態(tài)方程為： 將根據(jù)上面兩式來確定T的邏輯表達式 T=f(J,K,Q) 根據(jù)J-K觸發(fā)器的狀態(tài)表和T觸發(fā)器功能表可知，T應(yīng)為1。 根據(jù)觸發(fā)器功能轉(zhuǎn)換表可寫出T的邏輯表達式： 根據(jù)上面的公式可畫出T觸發(fā)器轉(zhuǎn)換成J-K觸發(fā)器的邏輯電路圖。 6. 設(shè)計一個3人搶答電路。3人A、B、C各控制一個按鍵開關(guān)KA、KB、KC和一個發(fā)光二極管DA、DB、DC。誰先按下開關(guān)，誰的發(fā)光二極管亮，同時使其他人的搶答信號無效。 不知道是啥